(原创)基于Microsoft1768板卡实现Win/Linux下Arria10器件的开发，环境配置和安装 FPGA Microsoft FPGA Model:1768 WA 98052-6399置顶
首先介绍一下Intel的Arria10器件Arria 10是英特尔（Intel）公司的一款可编程逻辑器件（FPGA），是Altera公司在被Intel收购之前推出的产品之一。Arria 10系列FPGA具有高性能、低功耗和高度可编程的特点，广泛应用于通信、计算、图像处理和工业控制...
Ubuntu下Quartus OpenCL实现手写数字识别 QuartusPro 18.1 Update2 Arria10置顶
环境：Arria10 FPGA 10AXF40GAE 10AXF40GAAAMD Ryzen™ 7 7735HS 8核16线程（实测编译速度与主频和核心数有关，可以上X99的双路服务器）英睿达DDR5 4800Mhz 32G*2（注意，内存应大于8G，并且越大越好，否则...
Versal ACAP Primer Handbook置顶
一、核心架构区别1. Versal（ACAP）异构计算架构 ：Versal是AMD/Xilinx推出的自适应计算加速平台（ACAP） ，集成多种计算单元：标量处理引擎 （Scalar Engine）：包含ARM Cortex-A72应用处理器（APU）和Cortex-R5实时处理器（RPU），支持L...
SI5394/SI5395/SI5392 上位机实现直接备份、修改、固化、实时配置时钟管理芯片 示例基于Xilinx Alevo U55C/U50/U280 NVM Program
首先说明这玩意非常麻烦，建议直接联系我付费修改。如果你非要自己修改，可能时间成本比联系我还要贵出很多倍。Firstly, it should be noted that this matter is very troublesome. It is recommended to contact me...
B50612D RGMII Verilog程序设计 UDP Demo
B50612D Datesheet：B50612D-datasheet.pdf对于B50612D这个芯片来说，使用的是RGMII接口，时钟频率和GMII一致，都是1000/8=125Mhz，但是省去了一半的引脚，所以在时钟的双边沿进行传输。一、操作流程芯片提供了一个低有效的复位接口，在上电后需要保持...
Verilog IIC器件枚举工具 SI5341 SI5394等器件也可使用
程序如下：`timescale 1ns / 1ps module i2c_address_scanner ( input wire SYSCLK2_P, ...
基于树莓派PICO RP2040使用Arduino对Si5351进行编程和配置
代码如下：#include <Adafruit_SI5351.h> #include <Wire.h> // 使用自定义 I2C 引脚配置 #define I2C_SDA 0 ...
Ubuntu安装XRT报错问题解决
在使用官方XRT deb进行安装时(https://xilinx.github.io/Alveo-Cards/master/debugging/build/html/docs/common-steps.html#determine-linux-release)：wget https://w...
Alveo U55C数据中心加速卡 安装至服务器并配置环境
板卡的侧面有JTAG接口：侧面有标准8P的供电接口，我用万用表点过试了一下：确认无误后安装至服务器：此时已经可以正确识别到加速卡：根据官方XRT要求，我们的操作系统环境需要为：这里我选择Ubuntu22.04.使用BMC进行远程安装：然后下载安装Vivado，这里过程省略。使用USB线连接到板卡，也...
预加重（Pre-emphasis）和去加重（De-emphasis）
一、基本概念预加重（Pre-emphasis）在信号发射端（发送端）对高频分量进行主动增强 ，以补偿信号在传输介质中因高频衰减导致的失真。核心目的 ：提升高频分量的幅度，改善信号完整性（Signal Integrity, SI）。典型场景 ：高速数字信号（如PCIe、USB）、光纤通信、FM广播等。...
Fly-by、Daisy Chain与T-topology对比
*以下内容的版权归MyFPGA.cn所有，仅用于非营利性的学习和教育目的，未经允许不得私自进行转载、引用或商业用途。在高速数字电路设计中，信号完整性（SI）和时序控制是核心挑战。不同的布线拓扑结构直接影响信号质量、抗干扰能力和系统稳定性。本文将对三种主流高速信号布线拓扑——Fly-by、Daisy...
高速PCB故障诊断与检查手册
*以下内容的版权归MyFPGA.cn所有，仅用于非营利性的学习和教育目的，未经允许不得私自进行转载、引用或商业用途。一、电源完整性故障矩阵故障类型子类根本原因检测方法解决方案预防措施低频纹波100Hz~1MHz范围超标- 电解电容ESR过高（>50mΩ）- 电源平面长宽比>10:1导致阻...
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