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使用Docker-Ubuntu14安装Synopsys2018工具 Leda PT VCS Verdi DVE FM SCL 爱快Docker EDA工具
FPGA BC-FPGA-HDL \BC-FPGA-VHDL BC-HDL BC-Schedule BC-VHDL Behavioral-Analyzer \Behavioral-Compiler BETA_......
FPGA时序分析和时序约束
FPGA设计中各个寄存器之间的数据和时钟传输路径，来分析数据延迟和时钟延迟之间的关系。一个设计OK的系统，必然能够保证整个系统中所有的寄存器都能够正确的寄存数据。数据和时钟传输路径是由EDA软件，通过针对特定器件布局布线得到的。时序约束：两个作用告知EDA软件，该设计需要达到怎样的时序指标，然后.....
点亮LED灯实验
FPGA.cn// Data : 20220811// Description : This is a simple//-----------------------------------module LED ( input key , // 按键输入......
在Ubuntu/Linux环境中用Python进行FPGA编程和OpenCL应用开发
FPGA(FieldProgrammableGateArray)技术的快速发展，越来越多的开发者开始使用Ubuntu或Linux环境进行FPGA的编程和开发工作。在本文中，我们将会介绍如何在Ubuntu/Linux环境中使用Python作为编程语言进行FPGA开发，以及如何在这些环境中使用......
CDC 单脉冲信号处理
FPGA.cn//Copyright(c)2018-Now,MYFPGA.CN,Allrightreserved.//------------------------------------------------------modulecdc( input......
Verilog实现串并转换
FPGA.cn//Copyright(c)2018-Now,MYFPGA.CN,Allrightreserved.//------------------------------------------------------moduleSIPO( inpu......
Xilinx FIFO和ILA学习
FPGA.cn//Website ﹕https://www.myFPGA.cn//Copyright(c)2018-2022,MYFPGA.CN,Allrightreserved//--------------------------......
Verilog实现时钟分频(奇数分频，偶数分频)二分频 三分频 四分频 五分频
FPGA.cn//Copyright(c)2018-Now,MYFPGA.CN,Allrightreserved.//------------------------------------------------------moduleclkdiv( in......
SOC 在线修改设备树和FPGA配置文件 并在线配置FPGA
FPGA配置程序：点击下载请连接至开发板并新建一个sh文件，内容如下#!/bin/shif[-f"soc_system.rbf"];thenif[-f"soc_system.dtb"];then......
使用ZYNQ7010安装PYNQ，基于PaddleLite实现目标检测+图片分类
FPGA做比较的？嘿嘿而且ZYNQ7010只要二三百块钱就能买一块。。。如果接受矿板，一百块钱就可以搞一个。查手册一看，原来是ZYNQ7000系列的ARM核带有NEON/FPU，真香~第二部分：FPGA加速CONV暂无......
