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                            chanra1n 管理员
全栈工程师;PMP、PBA、CSPM、Scrum Master(PSM-II)、敏捷专家;认证高级信息系统项目管理师、高级国际金融硕士在读、工商管理硕士在读、认证中级软件设计师、认证中级硬件工程师、认证中级嵌入式软件工程师、认证中级FPGA工程师;曾就职于中国航天科技集团某单位。 Email:[email protected]
400 篇文章 0 次评论使用爱快Docker安装Paddle对Paddle生成的模型进行预测
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    Ubuntu16.04 Armhf 内置APT源配置文件(备份)
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    解决APT-GET一直Waiting for header或者Working的问题
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    使用PaddleX对大量图片进行分类(仅包含预测的内容)
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    CDC 单脉冲信号处理
                                                        代码中的Sys_clk其实是没有用到的,项目文件:cdc_single.zip//------------------------------------------------------// File Name        : cdc.v// Autho...            
    Verilog实现串并转换
                                                        项目文件:SIPO.zip//------------------------------------------------------// File Name        : SIPO.v// Author       &n...            
    Xilinx FIFO和ILA学习
                                                        `timescale 1ns / 1ps//-------------------------------------------------------//Filename       ﹕ FIFO_TOP.v//Author      ...            
    Verilog实现时钟分频(奇数分频,偶数分频)二分频 三分频 四分频 五分频
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